概要
説明
The 651S is a low cost, high-speed single input to four output LVCMOS clock buffer. The 651S has best in class Additive Phase Jitter of sub 50 fsec.
特長
- Low additive phase jitter RMS: 50 fs
- Extremely low skew outputs (50 ps)
- Low cost clock buffer
- Packaged in 8-pin SOIC and 8-pin DFN, Pb-free
- Input / Output clock frequency up to 200 MHz
- Non-inverting output clock
- Ideal for networking clocks
- Operating Voltages: 1.8 V to 3.3 V
- Output Enable mode tri-states outputs
- Advanced, low power CMOS process
- Extended temperature range (-40°C to +105°C)
製品比較
アプリケーション
ドキュメント
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分類 | タイトル | 日時 |
データシート | PDF 305 KB | |
アプリケーションノート | PDF 187 KB | |
概要 | PDF 217 KB | |
製品変更通知 | PDF 268 KB | |
製品変更通知 | PDF 611 KB | |
製品変更通知 | PDF 611 KB | |
アプリケーションノート | PDF 495 KB | |
アプリケーションノート | PDF 442 KB | |
アプリケーションノート | PDF 565 KB | |
9 items
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設計・開発
モデル
ECADモデル
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![Diagram of ECAD Models](/themes/idt8/images/ecad-models.jpg)
ビデオ&トレーニング
Low-jitter LVCMOS Fanout Clock Buffers by IDT
This video overviews the LVCMOS Fanout Buffers, showcasing their best-in-class performance with extremely low phase jitter, minimal output skew, and low power consumption, along with other competitive features.
Video List